hpw422移植新的sdk
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xushaoxiang
@@ -0,0 +1,329 @@
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#ifndef SDK_CONFIG_H
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#define SDK_CONFIG_H
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// <<< Use Configuration Wizard in Context Menu >>>
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// XINCX_RF_EMHAMCED_PEACKET_MODE - RF enhanced packet mode
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// <i> Configure the frame format, which is a dynamic packet configuration, which can communicate in both directions,and
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// <i> ACK can dynamically carry data.
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#ifndef XINCX_RF_EMHAMCED_PACKET_MODE
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#define XINCX_RF_EMHAMCED_PACKET_MODE 1
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#endif
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#if (XINCX_RF_EMHAMCED_PACKET_MODE == 1)
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// <o> XINCX_RF_COMPATIBILITY_MODE - RF Compatibility mode
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// <0=> Xinchip_mode
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// <1=> Panchip_mode
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// <2=> Beken_mode
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// <3=> Telink_mode
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// <4=> Huntersun_mode
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#ifndef XINCX_RF_COMPATIBILITY_MODE
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#define XINCX_RF_COMPATIBILITY_MODE 0
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#endif
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// XINCX_2_4G_TRANS_PARAM - 2.4g Transmission Parameters
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//==========================================================
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// <o> XINCX_RF_MODE - RF Tx or Rx Mode
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// <0=> TX Mode
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// <1=> RX Mode
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#ifndef XINCX_RF_MODE
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#define XINCX_RF_MODE 1
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#endif
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// <o> XINCX_RF_TRANS_RATE - RF Transmission Rate Config
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// <0x02=> 1M
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// <0x0A=> 2M
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// <0x22=> 250k
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// <0x2A=> 125k
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#ifndef XINCX_RF_TRANS_RATE
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#define XINCX_RF_TRANS_RATE 0x02
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||||
#endif
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// <o> XINCX_2_4G_CHANNEL - 2.4g Channel Set
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#ifndef XINCX_2_4G_CHANNEL
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#define XINCX_2_4G_CHANNEL 2440
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||||
#endif
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// <o> XINCX_RF_TX_ADDR_WIDTH - RF Tx Addr Width
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// <3=> 3 Bytes
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// <4=> 4 Bytes
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// <5=> 5 Bytes
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#ifndef XINCX_RF_TX_ADDR_WIDTH
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#define XINCX_RF_TX_ADDR_WIDTH 5
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||||
#endif
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// <o> XINCX_2_4G_ADDR_L - rf Address Set
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#ifndef XINCX_2_4G_ADDR_L
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#define XINCX_2_4G_ADDR_L 0xe7e7e7e7
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||||
#endif
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||||
// <o> XINCX_2_4G_ADDR_H - rf Address Set
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||||
#ifndef XINCX_2_4G_ADDR_H
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||||
#define XINCX_2_4G_ADDR_H 0xe7
|
||||
#endif
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||||
// <o> XINCX_RF_POWER - rf Power Set
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||||
// <1=> -10dbm
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||||
// <2=> -9dbm
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||||
// <4=> -4dbm
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||||
// <6=> 0dbm
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||||
// <8=> 3dbm
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||||
// <9=> 5dbm
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||||
// <12=> 7dbm
|
||||
// <14=> 8dbm
|
||||
// <16=> 9dbm
|
||||
// <19=> 10dbm
|
||||
// <24=> 11dbm
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||||
// <30=> 12dbm
|
||||
// <36=> 13dbm
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#ifndef XINCX_POWER
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||||
#define XINCX_POWER 0x00006
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||||
#endif
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||||
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||||
// <o> XINCX_RF_NVIC_MODE - RF NVIC Mode
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||||
// <0=> Disable
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||||
// <1=> Enable
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#ifndef XINCX_RF_NVIC_MODE
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||||
#define XINCX_RF_NVIC_MODE 1
|
||||
#endif
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||||
// XINCX_2_4G_PIPE_RX_PAYLEN - 2.4g Pipe Rx Payload Len
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||||
// <i> Payload length. Configuration of the load length during communication.
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//==========================================================
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||||
// XINCX_2_4G_PIPE0_LEN - 2.4g Pipe0 Rx Payload Len
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||||
// #ifndef XINCX_2_4G_PIPE0_LEN
|
||||
// #define XINCX_2_4G_PIPE0_LEN 32
|
||||
// #endif
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||||
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||||
// XINCX_2_4G_PIPE1_LEN - 2.4g Pipe1 Rx Payload Len
|
||||
#ifndef XINCX_2_4G_PIPE1_LEN
|
||||
#define XINCX_2_4G_PIPE1_LEN 32
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_PIPE2_LEN - 2.4g Pipe2 Rx Payload Len
|
||||
#ifndef XINCX_2_4G_PIPE2_LEN
|
||||
#define XINCX_2_4G_PIPE2_LEN 32
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_PIPE3_LEN - 2.4g Pipe3 Rx Payload Len
|
||||
#ifndef XINCX_2_4G_PIPE3_LEN
|
||||
#define XINCX_2_4G_PIPE3_LEN 32
|
||||
#endif
|
||||
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||||
// XINCX_2_4G_PIPE4_LEN - 2.4g Pipe4 Rx Payload Len
|
||||
#ifndef XINCX_2_4G_PIPE4_LEN
|
||||
#define XINCX_2_4G_PIPE4_LEN 32
|
||||
#endif
|
||||
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||||
// XINCX_2_4G_PIPE5_LEN - 2.4g Pipe5 Rx Payload Len
|
||||
#ifndef XINCX_2_4G_PIPE5_LEN
|
||||
#define XINCX_2_4G_PIPE5_LEN 32
|
||||
#endif
|
||||
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||||
// XINCX_RF_CRC_ENABLE - RF CRC Enable
|
||||
//==========================================================
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||||
#ifndef XINCX_RF_CRC_ENABLE
|
||||
#define XINCX_RF_CRC_ENABLE 1
|
||||
#endif
|
||||
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||||
// <o> XINCX_2_4G_CRC_BYTE - 2.4g CRC Bytes Set
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||||
// <0=> 0 Byte
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||||
// <1=> 1 Byte
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||||
// <2=> 2 Bytes
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||||
#ifndef XINCX_2_4G_CRC_BYTE
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||||
#define XINCX_2_4G_CRC_BYTE 2
|
||||
#endif
|
||||
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||||
// XINCX_2_4G_FEATURE_PARAM - 2.4g Feature Parameters
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||||
//==========================================================
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||||
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||||
// XINCX_2_4G_GUARD_CFG - 2.4g Long Payload Feature
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||||
#ifndef XINCX_2_4G_GUARD_CFG
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||||
#define XINCX_2_4G_GUARD_CFG 0
|
||||
#endif
|
||||
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||||
// XINCX_2_4G_LONG_PLD_TYPE - 2.4g Long Pld Type
|
||||
#ifndef XINCX_2_4G_LONG_PLD_TYPE
|
||||
#define XINCX_2_4G_LONG_PLD_TYPE 0
|
||||
#endif
|
||||
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||||
// XINCX_2_4G_PREAMBLE_NUM - 2.4g Preamble
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||||
#ifndef XINCX_2_4G_PREAMBLE_NUM
|
||||
#define XINCX_2_4G_PREAMBLE_NUM 0
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_PREAMBLE_TYPE - 2.4g Preamble Type
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||||
#ifndef XINCX_2_4G_PREAMBLE_TYPE
|
||||
#define XINCX_2_4G_PREAMBLE_TYPE 0
|
||||
#endif
|
||||
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||||
// XINCX_2_4G_CRC_SCOPE_GUARD - 2.4g CRC Scope Guard
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||||
#ifndef XINCX_2_4G_CRC_SCOPE_GUARD
|
||||
#define XINCX_2_4G_CRC_SCOPE_GUARD 0
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_CRC_SCOPE_HEADER - 2.4g CRC Scope Header
|
||||
#ifndef XINCX_2_4G_CRC_SCOPE_HEADER
|
||||
#define XINCX_2_4G_CRC_SCOPE_HEADER 1
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_CRC_SCOPE_ADDR - 2.4g CRC Scope Addr
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||||
#ifndef XINCX_2_4G_CRC_SCOPE_ADDR
|
||||
#define XINCX_2_4G_CRC_SCOPE_ADDR 1
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_LONG_PLD - 2.4g Long Payload Feature
|
||||
#ifndef XINCX_2_4G_LONG_PLD
|
||||
#define XINCX_2_4G_LONG_PLD 1
|
||||
#endif
|
||||
|
||||
// <q> XINCX_2_4G_FEC - 2.4g FEC&Interleave Feature
|
||||
#ifndef XINCX_2_4G_FEC
|
||||
#define XINCX_2_4G_FEC 0
|
||||
#endif
|
||||
|
||||
// <q> XINCX_2_4G_WHITEN - 2.4g Whiten Feature
|
||||
#ifndef XINCX_2_4G_WHITEN
|
||||
#define XINCX_2_4G_WHITEN 1
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_DPL - 2.4g Dynamic Payload Length Feature
|
||||
#ifndef XINCX_2_4G_DPL
|
||||
#define XINCX_2_4G_DPL 1
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_ACK_PAY - 2.4g Payload on ACK
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||||
#ifndef XINCX_2_4G_ACK_PAY
|
||||
#define XINCX_2_4G_ACK_PAY 1
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_DYN_ACK - 2.4g W_TX_PAYLOAD_NOACK Command
|
||||
#ifndef XINCX_2_4G_DYN_ACK
|
||||
#define XINCX_2_4G_DYN_ACK 1
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_DYNPD - 2.4g dynpd
|
||||
#ifndef XINCX_2_4G_DYNPD
|
||||
#define XINCX_2_4G_DYNPD 0x3f
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_AUTO_ACK - 2.4g Auto Acknowledgement
|
||||
//==========================================================
|
||||
// XINCX_2_4G_PIPE0_ENAA - 2.4g Pipe0 Auto Ack
|
||||
#ifndef XINCX_2_4G_PIPE0_ENAA
|
||||
#define XINCX_2_4G_PIPE0_ENAA 1
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_PIPE1_ENAA - 2.4g Pipe1 Auto Ack
|
||||
#ifndef XINCX_2_4G_PIPE1_ENAA
|
||||
#define XINCX_2_4G_PIPE1_ENAA 1
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_PIPE2_ENAA - 2.4g Pipe2 Auto Ack
|
||||
#ifndef XINCX_2_4G_PIPE2_ENAA
|
||||
#define XINCX_2_4G_PIPE2_ENAA 1
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_PIPE3_ENAA - 2.4g Pipe3 Auto Ack
|
||||
#ifndef XINCX_2_4G_PIPE3_ENAA
|
||||
#define XINCX_2_4G_PIPE3_ENAA 1
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_PIPE4_ENAA - 2.4g Pipe4 Auto Ack
|
||||
#ifndef XINCX_2_4G_PIPE4_ENAA
|
||||
#define XINCX_2_4G_PIPE4_ENAA 1
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_PIPE5_ENAA - 2.4g Pipe5 Auto Ack
|
||||
#ifndef XINCX_2_4G_PIPE5_ENAA
|
||||
#define XINCX_2_4G_PIPE5_ENAA 1
|
||||
#endif
|
||||
// <o.0..5> XINCX_RF_PIPE_ENABLE
|
||||
#ifndef XINCX_RF_PIPE_ENABLE
|
||||
#define XINCX_RF_PIPE_ENABLE 3
|
||||
#endif
|
||||
// XINCX_2_4G_TRANS_PARAM - 2.4g Transmission Parameters
|
||||
//==========================================================
|
||||
|
||||
// <o> XINCX_2_4G_RETRANS_CNT - 2.4g Retransmit Count
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||||
// <i> Number of retransmissions. The maximum number of times a hardware can automatically transmit an ACK if it does
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||||
// not receive the correct ACK.
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||||
// <0=> No retransmission
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||||
// <1=> 1 time
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||||
// <2=> 2 times
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||||
// <3=> 3 times
|
||||
// <4=> 4 times
|
||||
// <5=> 5 times
|
||||
// <6=> 6 times
|
||||
// <7=> 7 times
|
||||
// <8=> 8 times
|
||||
// <9=> 9 times
|
||||
// <10=> 10 times
|
||||
// <11=> 11 times
|
||||
// <12=> 12 times
|
||||
// <13=> 13 times
|
||||
// <14=> 14 times
|
||||
// <15=> 15 times
|
||||
#ifndef XINCX_2_4G_RETRANS_CNT
|
||||
#define XINCX_2_4G_RETRANS_CNT 0
|
||||
#endif
|
||||
|
||||
// <o> XINCX_2_4G_RETRANS_DELAY - 2.4g Retransmission Delay
|
||||
// <i> Retransmission delay. For 32 bytes of data, the minimum configuration is 500 us for 1 Mbit/s and 1500 us for 250
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||||
// kbit/s.
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||||
// <0=> 250us
|
||||
// <1=> 500us
|
||||
// <2=> 750us
|
||||
// <3=> 1000us
|
||||
// <4=> 1250us
|
||||
// <5=> 1500us
|
||||
// <6=> 1750us
|
||||
// <7=> 2000us
|
||||
// <8=> 2250us
|
||||
// <9=> 2500us
|
||||
// <10=> 2750us
|
||||
// <11=> 3000us
|
||||
// <12=> 3250us
|
||||
// <13=> 3500us
|
||||
// <14=> 3750us
|
||||
// <15=> 4000us
|
||||
#ifndef XINCX_2_4G_RETRANS_DELAY
|
||||
#define XINCX_2_4G_RETRANS_DELAY 3
|
||||
#endif
|
||||
|
||||
#endif
|
||||
|
||||
// RF 2.4g Compatibility configuration
|
||||
//==========================================================
|
||||
// Compatibility configuration, when you need to be compatible with other RF chips, you don't need to configure this
|
||||
// option when using our company's chips.
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||||
// XINCX_2_4G_PREAMBLE - 2.4g preamble
|
||||
#ifndef XINCX_2_4G_PREAMBLE
|
||||
#define XINCX_2_4G_PREAMBLE 0x710f5555
|
||||
#endif
|
||||
|
||||
// XINCX_2_4G_GUARD - 2.4g guard
|
||||
#ifndef XINCX_2_4G_GUARD
|
||||
#define XINCX_2_4G_GUARD 0x8fc9
|
||||
#endif
|
||||
//
|
||||
|
||||
// XINCX_2_4G_CRY_CPT_ARRAY - 2.4g Crystal capacitor array
|
||||
//==========================================================
|
||||
// Crystal capacitor array, adjust to modify the frequency offset of the crystal oscillator.
|
||||
// XINCX_2_4G_CRY_CPT_ARRAY - 2.4g Crystal capacitor array
|
||||
#ifndef XINCX_2_4G_CRY_CPT_ARRAY
|
||||
#ifdef XC62XX
|
||||
#define XINCX_2_4G_CRY_CPT_ARRAY 0x38
|
||||
#else
|
||||
#define XINCX_2_4G_CRY_CPT_ARRAY 0x36
|
||||
#endif
|
||||
#endif
|
||||
//
|
||||
|
||||
// <<< end of configuration section >>>
|
||||
|
||||
#endif // SDK_CONFIG_H
|
||||
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